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当前位置: 首页 资源下载 搜索资源 - 时分复用 VHDL

搜索资源列表

  1. XPS_EMC.rar

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  2. Xilinx EDK中SOC使用外部存储器接口(EMC)的方法,并用ISP1581举例说明了如何与时分复用总线(8051单片机总线)设备进行连接,有Verilog源代码。,Xilinx EDK in SOC using external memory interface (EMC) methods, and examples of how ISP1581 with the TDM bus (8051 bus) devices to connect, there Verilog source co
  3. 所属分类:Other Embeded program

    • 发布日期:2017-03-23
    • 文件大小:59340
    • 提供者:YongZhiLi
  1. Decode

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  2. 十六位编解码器 时分复用解复用,很好的一个程序文件-Codec 16 demultiplexing time-division multiplexing, a very good program files
  3. 所属分类:mpeg mp3

    • 发布日期:2017-04-10
    • 文件大小:855
    • 提供者:login id
  1. FBR_TR16

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  2. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-13
    • 文件大小:1770
    • 提供者:login id
  1. voltage_comp_verilog

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  2. 实现对8通道模拟数据的高速采集,精度高,采用时分复用方法,避免的数据传输的错误。-8-channel to achieve high-speed analog data acquisition, high accuracy, using time-division multiplexing method, to avoid data transmission errors.
  3. 所属分类:Windows Develop

    • 发布日期:2017-05-08
    • 文件大小:1632536
    • 提供者:魏常伟
  1. a

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  2. 多路复用信号产生电路的建模与VHDL设计 时分多路 原理 模型 模块建模-Multiplexed signal generation circuit modeling and design of time-division multiplexing principle VHDL model modeling module
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:189161
    • 提供者:
  1. shixusuccessful

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  2. 利用VHDL语言,对时分复用通信系统的仿真实现,包括序列产生到序列接收等部分。-Simulation time division multiplexing communication system
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-03
    • 文件大小:587881
    • 提供者:齐伟利
  1. TDM

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  2. 利用时分复用技术将并行输入的四路八位二进制码的信号变成一路信号串行输出(TDM digital multiplex VHDL)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-05-02
    • 文件大小:14706688
    • 提供者:love*lh
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